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7.2下图截取了其中3个循环，分别读进数40H,FCH,FEH.
7.3下图为5次循环后读进的5个数，如图从地址00H开始存放。
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7.4下图为一次从RAM中读取负数，并计算平方并加到R3的过程
7.5下图为3个负数从RAM中读取判断，求得平方并求和的过程。 FC*FC+FE*FE+FF*FF=15H.
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九、心得体会
通过课程设计的学习设计过程，我从对CISC模型机的组成和工作原理毫不了解，到慢慢的独立设计完成，并实现了预期功能。这次课程设计我学会Altera MAX+plus ⅡEDA软件的使用，熟悉了VHDL语言，并能使用其进行期间的编程，当然，也能用图形描述文件（.Gdf）进行顶层电路的设计。最终能用EDA软件设计一个能完成一定功能的模型计算机，并通过功能仿真和在EDA实验平台上运行一个程序来验证模型机设计的正确性。在设计的过程中，我了解了每个机器码，每个微指令的作用，懂得模型机的原理。
此次的课程设计让我收获的不单单有课程的知识，也学会了自主学习、学会了细心解决问题，培养了自己做事的耐心活认真的态度，培养了调试纠错的良好素养，更有的就是加强了自己的实践动手能力。
十、附录（VHDL源文件）
8.1ROM的设计（保存汇编源代码对应的机器码以及地址）
程序：
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL; USE IEEE.STD_LOGIC_ARITH.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL; ENTITY ROM IS PORT( DOUT:OUT STD_LOGIC_VECTOR(15 DOWNTO 0); ADDR:IN STD_LOGIC_VECTOR(7 DOWNTO 0); CS_I:IN STD_LOGIC ); END ROM;
ARCHITECTURE A OF ROM IS BEGIN DOUT <=
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\--MOV R0,10H \--MOV R1,4H \--L1:INT R2 \ \--INC R0 \--DEC R1 \\ L1 \--MOV R0 10H \--MOV R1 4H \--L2:LAD(R0) R2 \ \ \ \ \ \--DEC R1 \--TEST R1 \ \ \END A;
8.2 ALU（运算器）
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;1 USE IEEE.STD_LOGIC_ARITH.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITY ALU IS PORT(
X: IN STD_LOGIC_VECTOR(7 DOWNTO 0); Y: IN STD_LOGIC_VECTOR(7 DOWNTO 0); S2,S1,S0: IN STD_LOGIC;
ALUOUT: OUT STD_LOGIC_VECTOR(7 DOWNTO 0) ;
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SF: OUT STD_LOGIC ); END ALU;
ARCHITECTURE A OF ALU IS
SIGNAL AA,BB,TEMP:STD_LOGIC_VECTOR(8 DOWNTO 0); BEGIN
PROCESS BEGIN
IF(S2='0' AND S1='0' AND S0='0') THEN --ADD AA<='0'&X; BB<='0'&Y;
TEMP<=AA+BB;
ALUOUT<=TEMP(7 DOWNTO 0); SF<=TEMP(7);
ELSIF(S2='0' AND S1='1' AND S0='0') THEN --INC AA<='0'&Y; TEMP<=AA+1;
ALUOUT<=TEMP(7 DOWNTO 0); SF<=TEMP(7);
ELSIF(S2='0' AND S1='1' AND S0='1') THEN --DEC AA<='0'&Y; TEMP<=AA-1;
ALUOUT<=TEMP(7 DOWNTO 0); SF<=TEMP(7); ELSIF(S2='1' AND S1='1' AND S0='1') THEN --MUL AA<='0'&X; BB<='0'&Y; TEMP<=AA*BB; ALUOUT<=TEMP(7 DOWNTO 0); ELSIF(S2='1' AND S1='0' AND S0='0') THEN --TEST AA<='0'&Y; SF<=AA(7);
ELSIF(S2='1' AND S1='1' AND S0='0') THEN --Rd->BUS ALUOUT<=Y; ELSE
ALUOUT<=\ SF<='0'; END IF; END PROCESS; END A;
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