定点原码一位除法器的设计(3)

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参考文献

[1] 李景华. 可编程程逻辑器件与EDA技术［M］.北京：东北大学出版社，2001 [2] 范延滨.微型计算机系统原理、接口与EDA设计技术[M].北京：北京邮电大学出版社，2006

[3] 王爱英.计算机组成与结构(第4版)[M].北京：清华大学出版社，2006 [4] 王冠.Verilog HDL与数字电路设计[M].北京：机械工业出版社，2005 [5] 江国强.EAD技术习题与实验[M].北京：电子工业出版社，2005 [6] 杜建国.Verilog HDL硬件描述语言[M].北京：国防工业出版社，2004

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附 录

MOV R0,#0BH MOV R1,#0DH MOV R2,#00H MOV R3,#04H MOV A,R1 SUB A,#00H JZ OVERFLOW MOV A,R0 SUB A,R1 MOV R0,A LOOP:

AND A,#10H SUB A,#00H JZ S1

SUB A,#10H JZ S2 S1:

MOV A,R0 RL A

MOV R0,A MOV A,R2 ADD A,#01H RL A

MOV R2,A MOV A,R0 SUB A,R1 MOV R0,A MOV A,R3 SUB A,#01H JZ NEXT MOV R3,A MOV A,R0 JMP LOOP S2:

MOV A,R0 ADD A,R1 MOV R0,A MOV A,R0 RL A

MOV R0,A MOV A,R2

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RL A

MOV R2,A MOV A,R0 SUB A,R1 MOV R0,A MOV A,R3 SUB A,#01H JZ NEXT MOV R3,A MOV A,R0 JMP LOOP NEXT: MOV A,R0 AND A,#10H SUB A,#00H JZ OUT1 SUB A,#10H JZ OUT2 OUT1: MOV A,R2 ADD A,#01H MOV R2,A OUT OUT2: MOV A,R2 OUT

OVERFLOW: END

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课程设计总结：首先本次课设努力认真地完成了。本设计可以进行原码一位除法运算。在汇编语言编辑的程序，其中遇到很多问题。例如如果利用汇编语言进行数据存储，汇编环境的规则，以及如何具体实现等问题。在我的精心努力下依次解决。本次课设用到恢复余数法实现的。其过程在上面陈述的很详细。 指导教师评语： 指导教师(签字)： 年 月 日 课程设计成绩

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