组成原理专科十套复习题

大专生期末试卷（一）

一、选择题（每小题2分，共30分）

1 某机字长64位，1位符号位，63位表示尾数，若用定点整数表示，则最大正整数位（ A ）。

A +(263-1) B +(264-1) C -(263-1) D -(264-1)

2 请从下面浮点运算器中的描述中选出两个描述正确的句子（AC ）。 A 浮点运算器可用两个松散连接的定点运算部件一阶码和尾数部件来实现。

B 阶码部件可实现加，减，乘，除四种运算。 C 阶码部件只进行阶码相加，相减和比较操作。 D 尾数部件只进行乘法和除法运算。 3 存储单元是指（ c ）。

A 存放1个二进制信息位的存储元 B 存放1个机器字的所有存储元集合 C 存放1个字节的所有存储元集合 D 存放2个字节的所有存储元集合

4 某机字长32位，存储容量1MB，若按字编址，它的寻址范围是（D ）。 A 0—1M B 0—512KB C 0—56K D 0—256KB 5 用于对某个寄存器中操作数的寻址方式为（ C）。 A 直接 B 间接 C 寄存器直接 D 寄存器间接 6 程序控制类的指令功能是（D ）。

A 进行算术运算和逻辑运算 B 进行主存与CPU之间的数据传送 C 进行CPU和I/O设备之间的数据传送 D 改变程序执行的顺序 7 指令周期是指（ C ）。

1

A CPU从主存取出一条指令的时间 B CPU执行一条指令的时间 C CPU从主存取出一条指令加上执行一条指令的时间 D 时钟周期时间

8 描述当代流行总线结构中基本概念不正确的句子是（ AC ）。 A 当代流行的总线不是标准总线

B 当代总线结构中，CPU和它私有的cache一起作为一个模块与总线相连 C 系统中允许有一个这样的CPU模块

9 CRT的颜色为256色，则刷新存储器每个单元的字长是（C ）。 A 256位 B 16位 C 8位 D 7位 10 发生中断请求的条件是（C ）。

A 一条指令执行结束 B 一次I/O操作结束 C 机器内部发生故障 D 一次DMA操作结束 11 中断向量地址是（ C ）。

A 子程序入口地址 B 中断服务程序入口地址 C 中断服务程序入口地址指示器 D 例行程序入口地址 12 IEEE1394所以能实现数据传送的实时性，是因为（ C ）。 A 除异步传送外，还提供同步传送方式 B 提高了时钟频率 C 除优先权仲裁外，还提供均等仲裁,紧急仲裁两种总线仲裁方式 D 能够进行热插拔

13 直接映射cache的主要优点是实现简单。这种方式的主要缺点是（ B ）。 A 它比其他cache映射方式价格更贵 B 如果使用中的2个或多个块映射到cache同一行，命中率则下降

C 它的存取时间大于其它cache映射方式 D cache中的块数随着主存容量增大而线性增加

14 虚拟存储器中段页式存储管理方案的特性为（ D ）。

2

A 空间浪费大，存储共享不易，存储保护容易，不能动态连接 B 空间浪费小，存储共享容易，存储保护不易，不能动态连接

C 空间浪费大，存储共享不易，存储保护容易，能动态连接 D 空间浪费小，存储共享容易，存储保护容易，能动态连接

15 安腾处理机的指令格式中，操作数寻址采用（ B ）。 A R-R-S型 B R-R-R型 C R-S-S型 D S-S-S型

二、分析题（10分）

下图所示为计算机系统的层次结构图。请在每一级框内填入适当的专用术语，并说明哪些是硬件级？哪些是软件级？

三、简答题（10分）

安腾处理机体系结构有什么特点？

四、计算题（12分）

已知：x=+126，y=-120， 求：① [x]原，[x]反，[x]补； ② [y]原，[y]反，[y]补； ③ [x]补+[y]补=? ④ 由③求得x+y=?

3

五、分析题（12分）

根据易失性、高密度、存储元的晶体管、在系统中的可写性，列表比较各种存储器（FLASH、SRAM、DRAM、ROM、EPROM、E2PROM）的性能。

六、证明题（12分）

用时空图法证明流水CPU比非流水CPU具有更高的吞吐率。

七、分析题（14分）

说明中断产生的条件，并画出中断处理过程流程图。

大专生期末试卷（二）

一、选择题（每小题2分，共30分）

1 冯·诺依曼机工作的基本方式的特点是（ B ）。

4

A 多指令流单数据流 B 按地址访问并顺序执行指令 C 堆栈操作 D 存贮器按内容选择地址 2 在机器数（ B ）中，零的表示形式是唯一的。 A 原码 B 补码 C 移码 D 反码

3 在定点二进制运算器中，减法运算一般通过（ D ）来实现。 A 原码运算的二进制减法器 B 补码运算的二进制减法器 C 原码运算的十进制加法器 D 补码运算的二进制加法器

4 某计算机字长32位，其存储容量为256MB，若按单字编址，它的寻址范围是（ D ）。

A 0—64MB B 0—32MB C 0—32M D 0—64M 5 主存贮器和CPU之间增加cache的目的是（ A ）。

A 解决CPU和主存之间的速度匹配问题 B 扩大主存贮器容量

C 扩大CPU中通用寄存器的数量

D 既扩大主存贮器容量，又扩大CPU中通用寄存器的数量

6 单地址指令中为了完成两个数的算术运算，除地址码指明的一个操作数外，另一个常需采用（ C ）。

A 堆栈寻址方式 B 立即寻址方式 C 隐含寻址方式 D 间接寻址方式 7 同步控制是（ C ）。

A 只适用于CPU控制的方式 B 只适用于外围设备控制的方式

C 由统一时序信号控制的方式 D 所有指令执行时间都相同的方式

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