第八章触发器及时序逻辑电路(15)

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真值表输入 CP 0 1 1 1 1 R × 0 1 0 1 S × 1 0 0 1 输出功能保持置1 置0 保持不定

Q n Q n 10 1 0 1

0 10 1 0 1 0 1

1 10 0 0 1 × ×

优点：CP=1期间接收信号缺点：CP=1期间，R、S仍直接控制着 Q和Q

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