第5章 锁存器与触发器 习题与参考答案36-66(19)

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CPQ00Q10Q20

0111

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1011

2101

3001

4110

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5010

6100

7000

[题6-21] 试用上升沿JK触发器构成异步3位二进制加法计数器，要求画出逻辑电路图，以及计数器输入时钟CLK与JK触发器输出端Q2~Q0的波形图。

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1

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CPQ0Q1Q2

000

0100

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2

3110

001

4101

5011

6111

7000

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1010

[题6-22] 同题6-21，将所设计计数器改为减法计数器。

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1

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CPQ0Q1Q2

000

0111

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2101

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5010

6100

7000

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1011

3001

4110

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[题6-23] 试用上升沿JK触发器构成同步3位二进制加法计数器，要求画出逻辑电路

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