基于FPGA四路电子抢答器设计(3)

下图为将程序下载到芯片前设置的引脚分布。

EDA课程设计四路电子抢答器设计

六、性能测试与分析

将R键拨到0观察数码管是否开始从60倒计时，然后再将R键拨回1，之后将使能信号EN拨至1，将cs,cg设置为想要输入的时间，然后将R拨至0，观察数码管是否显示修改过之后的时间，并从设置好的时间开始计时。在计时功能验证完成后，按下抢答信号，此时抢答器发出警报声，并在数码管上显示出最先抢答的组对应的编号，说明抢答器功能正常。

七、实验设备

装有QuartusⅡ的计算机，教学实验箱，导线若干。

八、心得体会

在EDA技术中最为瞩目的是以现代电子技术为特征的逻辑设计仿真测试技术。该技术只需要通过计算机就能对所设计的电子系统从不同层次的性能特点上，进行一系列准确的测试和仿真，大大的方便了我们的设计，避免了受现实中有限的器件的限制。

EDA课程设计四路电子抢答器设计

在本次课程设计中，我做的是四路抢答器。在最开始的一个礼拜，我先是从网络上找到了类似题目的课程设计，参考并阅读了他人的程序，然后再在电脑上按模块编写成序，编写完成后进行了仿真。在编写程序的过程中，我发现自己在对VHDL语言的掌握上还有很多欠缺，程序也是经过了许多遍的修改之后，才做到了在尽可能简练的基础上将功能完整实施出来。在自模块编写完成后我又开始进行了完整电路的设计，在电路连接完成后进行了时序仿真，在第一次仿真完成后我发现电路仿真结果与预期所设想的还存在一些差距，经检查发现是计时模块有一点问题，在经过改正之后，终于仿真出理想的时序图。

在这次课程设计中，我体会到了要想完成一个完整的设计是多么复杂与不易。通过这次课设，锻炼了我进行编程以及设计的能力，也让我认识到了自己的不足，更坚定了我认真学习的决心。

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